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No circuito abaixo, o sinal C é a entrada de relógio (clock) e o conjunto Q0 e Q1 é a saída, sendo Q0 o seu bit menos significativo. Considerar que as entradas J e K dos flip-flops estão permanentemente ligadas ao nível lógico alto.

Podemos afirmar que o circuito funciona como um contador assíncrono:

Em um sistema SDH (Hierarquia Digital Síncrona), pretende-se transportar tributários PDH (Hierarquia Digital Plesiócrona) de 2.048 kbps em um STM-1 (Módulo de Transporte Síncrono). Para fazer isso, os tributários de 2.048 kbps serão mapeados em contêineres C-O número máximo de tributários de 2.048 kbps, mapeados em contêineres C-12, que poderão ser transportados em um STM-1, é:

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A antena Yagi-Uda é um arranjo parasita, consistindo de um elemento ativo (dipolo) acrescido de condutores adicionais, denominados de elementos parasitas, que não são ligados à linha de transmissão.

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Considere uma instalação de uma rede local de computadores que inclui três VLANs (VLAN1, VLAN2 e VLAN3) em sua topologia. As VLANs foram segmentadas utilizando uma Switch L2. Considere, ainda, um pacote gerado por um computador pertencente à VLAN1 que deve ser encaminhado para um computador pertencente à VLAN3. Nessa situação, o encaminhamento do pacote na VLAN1 será realizado por meio

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